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    時(shí)脈樹架構(gòu)、集成電路及其布局方法與流程

    文檔序號(hào):12825163閱讀:來(lái)源:國(guó)知局

    技術(shù)特征:

    技術(shù)總結(jié)
    一種時(shí)脈樹架構(gòu)、集成電路及其布局方法。時(shí)脈樹架構(gòu)配置在半導(dǎo)體基板上。時(shí)脈樹架構(gòu)包含第一時(shí)脈線,其具有第一線寬且被設(shè)置在第一高度處。時(shí)脈樹架構(gòu)亦包含第二時(shí)脈線,其具有和第一線寬不同的第二線寬。第二時(shí)脈線被設(shè)置在第二高度處,而上述第二高度是從半導(dǎo)體基板的上表面測(cè)量得到的,且第二高度與第一高度相同。第一線寬與第一時(shí)脈線的第一電流位準(zhǔn)成比例,且第二線寬與第二時(shí)脈線的第二電流位準(zhǔn)成比例。

    技術(shù)研發(fā)人員:楊國(guó)男;王中興;鄭儀侃;拉古迪·古瑪
    受保護(hù)的技術(shù)使用者:臺(tái)灣積體電路制造股份有限公司
    技術(shù)研發(fā)日:2016.12.29
    技術(shù)公布日:2017.07.07
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