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可編程異步觸發(fā)延時(shí)器及其使用方法

文檔序號(hào):7507240閱讀:381來(lái)源:國(guó)知局
專利名稱:可編程異步觸發(fā)延時(shí)器及其使用方法
技術(shù)領(lǐng)域
本發(fā)明涉及一種可編程異步觸發(fā)延時(shí)器,尤其是一種由觸發(fā)器組成的可編程異步觸發(fā)延時(shí)器。本發(fā)明還涉及一種可編程異步觸發(fā)延時(shí)器的使用方法。
背景技術(shù)
在現(xiàn)有的電子測(cè)量和集成電路設(shè)計(jì)技術(shù)中,延時(shí)電路一般采用電阻電容延時(shí)或同步觸發(fā)鎖存觸發(fā)器或異步觸發(fā)的方式實(shí)現(xiàn)。
采用電阻電容延時(shí),不僅延時(shí)精度難以控制,而且需要占用很大的版圖面積,特別在需要大延時(shí)的地方(如秒級(jí)延時(shí))。
不管采用同步觸發(fā)鎖存觸發(fā)器還是一般異步觸發(fā)的方式,除了振蕩器和觸發(fā)器之外,都需要一些額外的門邏輯控制電路,如圖1所示。同步觸發(fā)由于觸發(fā)線路上存在寄生的電阻電容,因此在需要大延時(shí)觸發(fā)器比較多的情況下,難以精確同步觸發(fā)各個(gè)觸發(fā)器。一般異步觸發(fā)由于各個(gè)觸發(fā)器輸出的脈沖沿存在時(shí)間上的差異,在最后延時(shí)輸出的信號(hào)上消除毛刺又成為一個(gè)難題。

發(fā)明內(nèi)容
本發(fā)明所要解決的技術(shù)問(wèn)題是提供一種可編程異步觸發(fā)延時(shí)器及其使用方法,利用若干觸發(fā)器串接方式,簡(jiǎn)化了電路結(jié)構(gòu),解決了一般異步觸發(fā)中需要額外門控制電路的問(wèn)題,有利于集成電路集成化的提高。
為解決上述技術(shù)問(wèn)題,本發(fā)明可編程異步觸發(fā)延時(shí)器的技術(shù)方案是,包括n個(gè)T′觸發(fā)器,所述n個(gè)T′觸發(fā)器依次逐個(gè)連接,前一個(gè)T′觸發(fā)器的輸出端與后一個(gè)T′觸發(fā)器的CLK端相連接,第1個(gè)的T′觸發(fā)器的CLK端接外部時(shí)鐘脈沖,所述這些T′觸發(fā)器的SET端和RST端為計(jì)數(shù)值輸入端,從第1個(gè)T′觸發(fā)器到第n個(gè)T′觸發(fā)器分別對(duì)應(yīng)輸入二進(jìn)制數(shù)據(jù)的最低位到最高位,本發(fā)明還包括第n+1個(gè)T′觸發(fā)器,該T′觸發(fā)器的CLK端接到第n個(gè)T′觸發(fā)器的輸出端,該T′觸發(fā)器的輸出端為延時(shí)信號(hào)輸出端,所述T′觸發(fā)器的個(gè)數(shù)n大于或等于延時(shí)時(shí)間除以外部時(shí)鐘脈沖周期所得到的二進(jìn)制計(jì)數(shù)值的位數(shù)。
上述電路的使用方法是,首先用延時(shí)時(shí)間除以外部時(shí)鐘脈沖周期得到計(jì)數(shù)值,將計(jì)數(shù)值轉(zhuǎn)換為二進(jìn)制數(shù),根據(jù)該二進(jìn)制數(shù)分別將相應(yīng)位的觸發(fā)器置1或清0。然后使所有觸發(fā)器的SET端和RST端全部無(wú)效,這時(shí)延時(shí)時(shí)間開始。在延時(shí)時(shí)間開始前還必須將最后一個(gè)觸發(fā)器A清0。
本發(fā)明為異步觸發(fā)方式,不存在同步觸發(fā)所需的精確同步觸發(fā)問(wèn)題;用最后的觸發(fā)器輸出作為延時(shí)輸出信號(hào),簡(jiǎn)化了電路結(jié)構(gòu),解決了一般異步觸發(fā)中需要額外門控制電路的問(wèn)題,有利于集成電路集成化的提高;由于不需要額外的門邏輯控制電路,因此最后延時(shí)輸出的信號(hào)上消除了毛刺現(xiàn)象;并可方便的改變或控制延時(shí)時(shí)間,改變延時(shí)時(shí)間只要相應(yīng)的把有關(guān)觸發(fā)器的初始態(tài)改變即可;特別適用于大延時(shí)的情況,例如數(shù)秒延時(shí)。


下面結(jié)合附圖和實(shí)施例對(duì)本發(fā)明作進(jìn)一步描述圖1為現(xiàn)有的觸發(fā)延時(shí)器的電路圖;圖2為本發(fā)明可編程異步觸發(fā)延時(shí)器使用T′觸發(fā)器的實(shí)施例電路圖;圖3為本發(fā)明可編程異步觸發(fā)延時(shí)器使用T觸發(fā)器的實(shí)施例電路圖;圖4、圖5、圖6、圖7本發(fā)明可編程異步觸發(fā)延時(shí)器使用D觸發(fā)器的四種
具體實(shí)施例方式
本發(fā)明可編程異步觸發(fā)延時(shí)器的電路結(jié)構(gòu)如圖2所示,包括n個(gè)T′觸發(fā)器,所述n個(gè)T′觸發(fā)器依次逐個(gè)連接,前一個(gè)T′觸發(fā)器的輸出端與后一個(gè)T′觸發(fā)器的CLK端相連接,第1個(gè)的T′觸發(fā)器的CLK端接外部時(shí)鐘脈沖,所述這些T′觸發(fā)器的SET端和RST端為計(jì)數(shù)值輸入端,從第1個(gè)T′觸發(fā)器到第n個(gè)T′觸發(fā)器分別對(duì)應(yīng)輸入二進(jìn)制數(shù)據(jù)的最低位到最高位,本發(fā)明還包括第n+1個(gè)T′觸發(fā)器,該T′觸發(fā)器的CLK端接到第n個(gè)T′觸發(fā)器的輸出端,該T′觸發(fā)器的輸出端為延時(shí)信號(hào)輸出端,所述T′觸發(fā)器的個(gè)數(shù)n大于或等于延時(shí)時(shí)間除以外部時(shí)鐘脈沖周期所得到的二進(jìn)制計(jì)數(shù)值的位數(shù)。
本發(fā)明中的T′觸發(fā)器可以由T觸發(fā)器構(gòu)成,如圖2和圖3所示,T觸發(fā)器輸入為高電平有效,T觸發(fā)器的T輸入端恒有效,即恒為高電平“1”,T觸發(fā)器的CLK端就是T′觸發(fā)器的CLK端,T觸發(fā)器的輸出端就是T′觸發(fā)器的輸出端。
本發(fā)明中的T′觸發(fā)器還可以由D觸發(fā)器構(gòu)成,如圖2和圖4、圖5、圖6、圖7所示,D觸發(fā)器的D輸入端接到其自身的反向輸出端,D觸發(fā)器的CLK端就是T′觸發(fā)器的CLK端,T′觸發(fā)器的輸出端可以是D觸發(fā)器的正向輸出端,也可以是D觸發(fā)器的反向輸出端。
圖4中,所有T′觸發(fā)器的輸出端都是D觸發(fā)器的正向輸出端。
圖5中,前n個(gè)T′觸發(fā)器的輸出端是D觸發(fā)器的正向輸出端,而第n+1個(gè)T′觸發(fā)器的輸出端是D觸發(fā)器的反向輸出端。
圖6中,前n個(gè)T′觸發(fā)器的輸出端是D觸發(fā)器的反向輸出端,而第n+1個(gè)T′觸發(fā)器的輸出端是D觸發(fā)器的正向輸出端。
圖7中,所有T′觸發(fā)器的輸出端都是D觸發(fā)器的反向輸出端。
本發(fā)明中的T′觸發(fā)器也可以由JK觸發(fā)器構(gòu)成,如圖2和圖8、圖9、圖10、圖11所示,JK觸發(fā)器為輸入為高電平有效,JK觸發(fā)器的J輸入端與K輸入端都恒有效,即J輸入端與K輸入端都接高電平“1”,JK觸發(fā)器的CLK端就是T′觸發(fā)器的CLK端,T′觸發(fā)器的輸出端可以是JK觸發(fā)器的正向輸出端,也可以是JK觸發(fā)器的反向輸出端。
圖8中,所有T′觸發(fā)器的輸出端都是JK觸發(fā)器的正向輸出端。
圖9中,前n個(gè)T′觸發(fā)器的輸出端是JK觸發(fā)器的正向輸出端,而第n+1個(gè)T′觸發(fā)器的輸出端是JK觸發(fā)器的反向輸出端。
圖10中,前n個(gè)T′觸發(fā)器的輸出端是JK觸發(fā)器的反向輸出端,而第n+1個(gè)T′觸發(fā)器的輸出端是JK觸發(fā)器的正向輸出端。
圖11中,所有T′觸發(fā)器的輸出端都是JK觸發(fā)器的反向輸出端。
該電路的使用方法是,用延時(shí)時(shí)間除以外部時(shí)鐘脈沖周期得到計(jì)數(shù)值,將計(jì)數(shù)值轉(zhuǎn)換為二進(jìn)制數(shù),根據(jù)該二進(jìn)制數(shù)分別將相應(yīng)位的觸發(fā)器置1或清0。然后使所有觸發(fā)器的SET端和RST端全部無(wú)效,這時(shí)延時(shí)時(shí)間開始。在延時(shí)時(shí)間開始前還必須將最后一個(gè)觸發(fā)器A清0。此外,觸發(fā)器的個(gè)數(shù)n還要和延時(shí)時(shí)間相對(duì)應(yīng),即n大于或等于二進(jìn)制計(jì)數(shù)值的位數(shù)。
假設(shè)振蕩器周期為40us,需要延時(shí)為1s,所有觸發(fā)器的SET端和RST端都是高電平有效,電路按照?qǐng)D2方式連接,則計(jì)算得需要的計(jì)數(shù)值為25000,相應(yīng)二進(jìn)制為110000110101000。將觸發(fā)器A清0;將第1、2、3、5、7、10、11、12和13個(gè)D觸發(fā)器狀態(tài)清0;將第4、6、8、9、14和15個(gè)觸發(fā)器的狀態(tài)置1。觸發(fā)器清0的方法是將SET端清0并將RST端置1;觸發(fā)器置1的方法是將RST端清0并將SET端置1。然后使所有觸發(fā)器的SET端和RST端全部無(wú)效,具體方法是將觸發(fā)器的SET端和RST端都清0;當(dāng)觸發(fā)器A的輸出Q從0變成1時(shí),則為1s延時(shí)。
權(quán)利要求
1.可編程異步觸發(fā)延時(shí)器,包括n個(gè)T′觸發(fā)器,所述n個(gè)T′觸發(fā)器依次逐個(gè)連接,前一個(gè)T′觸發(fā)器的輸出端與后一個(gè)T′觸發(fā)器的CLK端相連接,第1個(gè)的T′觸發(fā)器的CLK端接外部時(shí)鐘脈沖,所述這些T′觸發(fā)器的SET端和RST端為計(jì)數(shù)值輸入端,從第1個(gè)T′觸發(fā)器到第n個(gè)T′觸發(fā)器分別對(duì)應(yīng)輸入二進(jìn)制數(shù)據(jù)的最低位到最高位,其特征在于,還包括第n+1個(gè)T′觸發(fā)器,該T′觸發(fā)器的CLK端接到第n個(gè)T′觸發(fā)器的輸出端,該T′觸發(fā)器的輸出端為延時(shí)信號(hào)輸出端,所述T′觸發(fā)器的個(gè)數(shù)n大于或等于延時(shí)時(shí)間除以外部時(shí)鐘脈沖周期所得到的二進(jìn)制計(jì)數(shù)值的位數(shù)。
2.根據(jù)權(quán)利要求1所述的可編程異步觸發(fā)延時(shí)器,其特征在于,所述T′觸發(fā)器由T觸發(fā)器構(gòu)成,所述T觸發(fā)器的T輸入端恒有效,T觸發(fā)器的CLK端就是T′觸發(fā)器的CLK端,T觸發(fā)器的輸出端就是T′觸發(fā)器的輸出端。
3.根據(jù)權(quán)利要求1所述的可編程異步觸發(fā)延時(shí)器,其特征在于,所述T′觸發(fā)器由D觸發(fā)器構(gòu)成,所述D觸發(fā)器的D輸入端接到其自身的反向輸出端,D觸發(fā)器的CLK端就是T′觸發(fā)器的CLK端,T′觸發(fā)器的輸出端可以是D觸發(fā)器的正向輸出端,也可以是D觸發(fā)器的反向輸出端。
4.根據(jù)權(quán)利要求1所述的可編程異步觸發(fā)延時(shí)器,其特征在于,所述T′觸發(fā)器由JK觸發(fā)器構(gòu)成,所述JK觸發(fā)器的J輸入端與K輸入端都恒有效,JK觸發(fā)器的CLK端就是T′觸發(fā)器的CLK端,T′觸發(fā)器的輸出端可以是JK觸發(fā)器的正向輸出端,也可以是JK觸發(fā)器的反向輸出端。
5.可編程異步觸發(fā)延時(shí)器的使用方法,其特征在于,首先用延時(shí)時(shí)間除以外部時(shí)鐘脈沖周期得到計(jì)數(shù)值,將計(jì)數(shù)值轉(zhuǎn)換為二進(jìn)制數(shù),根據(jù)該二進(jìn)制數(shù)分別將相應(yīng)位的觸發(fā)器置1或清0。然后使所有觸發(fā)器的SET端和RST端全部無(wú)效,這時(shí)延時(shí)時(shí)間開始。在延時(shí)時(shí)間開始前還必須將最后一個(gè)觸發(fā)器A清0。
全文摘要
本發(fā)明公開了一種可編程異步觸發(fā)延時(shí)器及其使用方法,觸發(fā)延時(shí)器包括若干個(gè)T′觸發(fā)器,這些T′觸發(fā)器依次逐個(gè)連接,前一個(gè)T′觸發(fā)器的輸出端與后一個(gè)T′觸發(fā)器的CLK端相連接,第1個(gè)的T′觸發(fā)器的CLK端接外部時(shí)鐘脈沖,最后一個(gè)T′觸發(fā)器,的輸出端為延時(shí)信號(hào)輸出端。其使用方法是按照延時(shí)時(shí)間對(duì)每個(gè)觸發(fā)器的RST端和SET端進(jìn)行設(shè)置,然后將上述兩個(gè)輸入端無(wú)效,并輸入固定時(shí)鐘脈沖。本發(fā)明用最后的觸發(fā)器輸出作為延時(shí)輸出信號(hào),簡(jiǎn)化了電路結(jié)構(gòu),解決了一般異步觸發(fā)中需要額外門控制電路的問(wèn)題,并可方便的改變或控制延時(shí)時(shí)間,特別適用于大延時(shí)的情況。
文檔編號(hào)H03K5/13GK1797948SQ20041009355
公開日2006年7月5日 申請(qǐng)日期2004年12月24日 優(yōu)先權(quán)日2004年12月24日
發(fā)明者吳鑌 申請(qǐng)人:科圓半導(dǎo)體(上海)有限公司
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