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一種嵌入式測試存儲系統(tǒng)的制作方法

文檔序號:12780646閱讀:來源:國知局

技術(shù)特征:

1.一種嵌入式測試存儲系統(tǒng),其特征在于,包括主處理器電路、通訊接口、信號采集電路、信號調(diào)理電路接口和SDRAM存儲接口電路;

所述主處理器電路的第一輸入端與通訊接口相連,主處理器電路的第二輸入端與信號采集電路的輸出端相連,主處理器電路的第三端是一個雙向接口,與SDRAM存儲接口電路相連;信號調(diào)理電路接口的輸出端與信號采集電路的輸入端相連,信號調(diào)理電路接口的輸入端用于接入外部模擬信號。

2.如權(quán)利要求1所述的嵌入式測試存儲系統(tǒng),其特征在于,所述主處理器電路包括ARM微處理器、Fabric查詢表模塊、SMC_FIC軟存儲模塊、CORE_AXI高級可擴(kuò)展模塊、SDR_AXI高級可擴(kuò)展接口模塊、DDR Bridge橋式連接模塊、RS422串口總線模塊、AD采樣控制轉(zhuǎn)換模塊和FAB_CCC時鐘調(diào)節(jié)模塊;

所述RS422串口總線模塊和AD采樣控制轉(zhuǎn)換模塊通過AHB總線矩陣與ARM微處理器的一端相連;所述ARM微處理器的另一端與DDR Bridge橋式連接模塊的第一端相連;所述SMC_FIC軟存儲模塊的第一端與DDRBridge橋式連接模塊的第二端相連;所述CORE_AXI高級可擴(kuò)展模塊的第一端與SMC_FIC軟存儲模塊的第二端相連;所述SDR_AXI高級可擴(kuò)展接口模塊的第一端與CORE_AXI高級可擴(kuò)展模塊的第二端相連;所述Fabric查詢表模塊的第一端與SDR_AXI高級可擴(kuò)展接口模塊的第二端相連,第二端用作連接外部SDRAM存儲器的接口;所述FAB_CCC時鐘調(diào)節(jié)模塊的第一端與SDR_AXI高級可擴(kuò)展接口模塊的第三端相連,第二端與DDRBridge橋式連接模塊的第三端相連。

3.如權(quán)利要求2所述的嵌入式測試存儲系統(tǒng),其特征在于,所述RS422串口總線模塊用于將主處理器的總線接口連接到AHB總線矩陣,并通過Fabric查詢表模塊與所述通訊接口連接,實(shí)現(xiàn)數(shù)據(jù)交互;

AD采樣控制轉(zhuǎn)換模塊用于將所述信號采集電路采集的模擬信號轉(zhuǎn)換為數(shù)字信號后通過AHB總線矩陣和Fabric查詢表模塊發(fā)送到ARM微處理器,實(shí)現(xiàn)對采集到的模擬信號的轉(zhuǎn)換及傳輸;

信號調(diào)理電路接口用于將外部模擬信號調(diào)理到AD采樣控制轉(zhuǎn)換模塊可采樣的信號范圍;

外部SDRAM存儲接口電路通過SDR_AXI高級可擴(kuò)展接口模塊連接到CORE_AXI高級可擴(kuò)展模塊,并通過SMC_FIC軟存儲模塊將外部SDRAM存儲器的數(shù)據(jù)發(fā)送ARM微處理器,或?qū)RM微處理器接收到的數(shù)據(jù)發(fā)送給外部SDRAM存儲器,實(shí)現(xiàn)數(shù)據(jù)讀取和存儲;

DDR Bridge橋式連接模塊用于實(shí)現(xiàn)SMC_FIC軟存儲模塊與ARM模塊的數(shù)據(jù)交互,F(xiàn)AB_CCC時鐘調(diào)節(jié)模塊用于為DDR Bridge橋式連接模塊和SDR_AXI高級可擴(kuò)展接口模塊提供可調(diào)時鐘。

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