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1×9超低速DDMI光模塊的制作方法

文檔序號:12266232閱讀:4326來源:國知局
1×9超低速DDMI光模塊的制作方法與工藝

本實用新型涉及光通信領(lǐng)域,尤其涉及一種1×9超低速DDMI光模塊。



背景技術(shù):

1X9封裝的光模塊產(chǎn)品最早產(chǎn)生于1999年,是固定的光模塊產(chǎn)品,通常直接焊接在通訊設(shè)備的電路板上,作為固定的光模塊使用,有時候也叫9針或9PIN光模塊。是早期光模塊的最常見的一種封裝形式,也是市場需求量非常大的一種類型,主要用在光纖收發(fā)器,PDH光端機(jī),光纖交換機(jī),單多模轉(zhuǎn)換器以及一些工業(yè)控制領(lǐng)域,然而隨著通信行業(yè)發(fā)展需求,原有1X9超低速光模塊收發(fā)端無監(jiān)控功能,只能通過硬件設(shè)施(光功率計)來監(jiān)測光模塊的發(fā)射光功率和接收光功率,大大的提高了使用成本。



技術(shù)實現(xiàn)要素:

本實用新型旨在提供一種1×9超低速DDMI光模塊,不需用光功率計來監(jiān)測光模塊實時的發(fā)射光功率和接收光功率,在使用設(shè)備上,直接就能監(jiān)測到光模塊實時的發(fā)射光功率和接收到的光功率指標(biāo)。

為達(dá)到上述目的,本實用新型是采用以下技術(shù)方案實現(xiàn)的:

本實用新型公開的1×9超低速DDMI光模塊,包括電接口、光發(fā)射器件、光接收器件、MCU、比較器、邏輯電路和APC控制電路,所述電接口、光發(fā)射器件、光接收器件均連接MCU;電接口連接邏輯電路,所述邏輯電路連接光發(fā)射器件;所述光接收器件連接比較器,所述比較器連接電接口;所述APC控制電路連接光發(fā)射器件和MCU。

優(yōu)選的,所述光發(fā)射器件光發(fā)射器件包括光發(fā)射次模塊,所述APC控制電路包括放大電路,所述放大電路連接光發(fā)射次模塊。

優(yōu)選的,所述光發(fā)射次模塊為VCSEL-155M,所述放大電路包括運算放大器,所述運算放大器的同相輸入端連接電阻R15的一端、電阻R13的一端、電阻R17的一端,電阻R15的另一端連接基準(zhǔn)電壓,電阻R13的另一端連接MCU的數(shù)據(jù)口,電阻R17的另一端接地,運算放大器的反相輸入端通過電阻R7連接光發(fā)射次模塊LD1的3腳,光發(fā)射次模塊LD1的3腳通過電阻R8接地,運算放大器的反相輸入端與輸出端之間連接電容C8,運算放大器的輸出端連接NPN三極管Q1的基極,NPN三極管Q1的集電極連接電阻R9的一端,電阻R9的另一端連接光發(fā)射次模塊的1腳、電阻R6的一端,電阻R6的另一端連接MCU的數(shù)據(jù)口,NPN三極管Q1的發(fā)射極通過電阻R16接地;所述電阻R7為0歐姆電阻。

優(yōu)選的,所述基準(zhǔn)電壓由基準(zhǔn)電壓源ADR5040產(chǎn)生,所述基準(zhǔn)電壓源ADR5040的1腳連接電阻R15的另一端、電阻R14的一端、電容C11的一端,電阻R14的另一端連接直流電源正極,電容C11的另一端連接基準(zhǔn)電壓源ADR5040的2腳并接地。

進(jìn)一步的,所述運算放大器的同相輸入端連接電容C10的一端,電容C10的另一端接地。

進(jìn)一步的,所述NPN三極管Q1的基極連接電容C9的一端,電容C9的另一端接地。

優(yōu)選的,所述光發(fā)射次模塊LD1的2腳連接電容C4的一端、電容C5的一端、電阻R4的一端,電容C4的另一端、電容C5的另一端均接地,電阻R4的另一端連接直流電源正極,所述電阻R4為0歐姆電阻。

優(yōu)選的,所述MCU為8051。

優(yōu)選的,所述運算放大器為OP系列通用運算放大器。

本實用新型重新設(shè)計1x9排針管腳定義,增加MCU、APC控制電路,將不帶背光發(fā)射器件更改為帶背光發(fā)射器件,將普通單PIN光接收器件更改為PIN TIA帶監(jiān)控光接收器件,從而達(dá)到DDMI功能的要求。

本實用新型不需用光功率計來監(jiān)測光模塊實時的發(fā)射光功率和接收光功率,在使用設(shè)備上,直接就能監(jiān)測到光模塊實時的發(fā)射光功率和接收到的光功率指標(biāo)。

附圖說明

圖1為本實用新型的原理框圖;

圖2為APC控制電路的電路原理圖;

圖3為MCU部分的電路原理圖;

圖4為本實用新型的引腳排列圖。

具體實施方式

為了使本實用新型的目的、技術(shù)方案及優(yōu)點更加清楚明白,以下結(jié)合附圖,對本實用新型進(jìn)行進(jìn)一步詳細(xì)說明。

如圖1所示,本實用新型公開的1×9超低速DDMI光模塊,包括電接口、光發(fā)射器件、光接收器件、MCU、比較器、邏輯電路和APC控制電路,電接口、光發(fā)射器件、光接收器件均連接MCU;電接口連接邏輯電路,邏輯電路連接光發(fā)射器件;光接收器件連接比較器,比較器連接電接口;APC控制電路連接光發(fā)射器件和MCU。

如圖2、圖3所示,光發(fā)射器件光發(fā)射器件包括光發(fā)射次模塊,APC控制電路包括放大電路,放大電路連接光發(fā)射次模塊;光發(fā)射次模塊為VCSEL-155M,放大電路包括運算放大器,運算放大器采用OP系列通用運算放大器,運算放大器的同相輸入端連接電阻R15的一端、電阻R13的一端、電阻R17的一端,電阻R15的另一端連接基準(zhǔn)電壓,光發(fā)射次模塊LD1的2腳連接電容C4的一端、電容C5的一端、電阻R4的一端,電容C4的另一端、電容C5的另一端均接地,電阻R4的另一端連接直流電源正極,所述電阻R4為0歐姆電阻,電阻R13的另一端連接MCU的數(shù)據(jù)口,MCU采用8051系列,電阻R17的另一端接地,運算放大器的同相輸入端連接電容C10的一端,電容C10的另一端接地;運算放大器的反相輸入端通過電阻R7連接光發(fā)射次模塊LD1的3腳,光發(fā)射次模塊LD1的3腳通過電阻R8接地,運算放大器的反相輸入端與輸出端之間連接電容C8,運算放大器的輸出端連接NPN三極管Q1的基極,NPN三極管Q1的基極連接電容C9的一端,電容C9的另一端接地,NPN三極管Q1的集電極連接電阻R9的一端,電阻R9的另一端連接光發(fā)射次模塊的1腳、電阻R6的一端,電阻R6的另一端連接MCU的數(shù)據(jù)口,NPN三極管Q1的發(fā)射極通過電阻R16接地;所述電阻R7為0歐姆電阻。

基準(zhǔn)電壓由基準(zhǔn)電壓源ADR5040產(chǎn)生,基準(zhǔn)電壓源ADR5040的1腳連接電阻R15的另一端、電阻R14的一端、電容C11的一端,電阻R14的另一端連接直流電源正極,電容C11的另一端連接基準(zhǔn)電壓源ADR5040的2腳并接地。

如圖4所示,本實用新型重新設(shè)計了光模塊的引腳,將不帶背光發(fā)射器件更改為帶背光發(fā)射器件,將普通單PIN光接收器件更改為PIN TIA帶監(jiān)控光接收器件。

當(dāng)然,本實用新型還可有其它多種實施例,在不背離本實用新型精神及其實質(zhì)的情況下,熟悉本領(lǐng)域的技術(shù)人員可根據(jù)本實用新型作出各種相應(yīng)的改變和變形,但這些相應(yīng)的改變和變形都應(yīng)屬于本實用新型所附的權(quán)利要求的保護(hù)范圍。

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