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針對地址/控制信號使用雙倍數(shù)據(jù)速率方案的具有減少的接口引腳需要的雙通道存儲器架構(gòu)的制作方法技術(shù)資料下載

技術(shù)編號:6592955

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本發(fā)明的實施例大體上涉及存儲器架構(gòu),且更明確地說,涉及具有減少的接口引 腳需要的雙倍數(shù)據(jù)通道存儲器架構(gòu)電路。背景技術(shù)在一些應(yīng)用中,處理器可具有傳送少量數(shù)據(jù)的較大百分比的存儲器存取操作。此 類存儲器存取操作可一般稱為突發(fā)長度存取(例如,突發(fā)長度讀取和/或突發(fā)長度寫入)。 當前研究表明,對于小突發(fā)長度存取,存取存儲器裝置的多個窄的獨立數(shù)據(jù)通道可提供比 具有寬存儲器接口的單一數(shù)據(jù)通道更好的性能。因此,具有單一寬通道存儲器接口的現(xiàn)有 系統(tǒng)可通過增加數(shù)據(jù)通道的數(shù)目同...
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