專(zhuān)利名稱(chēng)：一種地址跳轉(zhuǎn)輸出裝置和方法
技術(shù)領(lǐng)域：
本發(fā)明涉及一種地址跳轉(zhuǎn)輸出裝置和方法。
背景技術(shù)：
目前，在芯片電路設(shè)計(jì)中， 地址跳轉(zhuǎn)是經(jīng)常遇到的問(wèn)題。很多時(shí)候，在電路的不同部分需要不同的地址跳轉(zhuǎn)方式，比如，第一個(gè)部分需要按照0，64，128，192，I, 65，129，193···這樣跳轉(zhuǎn)地址，而第二部分變?yōu)榘凑?，16，32，48，I, 17，33，49….這樣跳轉(zhuǎn)。在傳統(tǒng)的解決辦法中，會(huì)將不同部分的電路按照不同的計(jì)數(shù)方式去做，來(lái)達(dá)到要求的跳轉(zhuǎn)效果。但是這樣每個(gè)部分都需要做不同的計(jì)數(shù)條件判斷，非常麻煩，而且容易沖突和出錯(cuò)。如CN102160032A專(zhuān)利提到的地址產(chǎn)生電路，其設(shè)置了塊大小和跳越大小，本質(zhì)上還是基于對(duì)跳轉(zhuǎn)條件的一個(gè)判斷，這種做法沒(méi)有降低多少?gòu)?fù)雜性。再如CN101027633A專(zhuān)利中提到的“有效地址=(段+位移)+基址+ (變化*比例)”，這種方式實(shí)現(xiàn)上也相當(dāng)復(fù)雜，而且這種地址的產(chǎn)生只適合于AGU這樣的特殊場(chǎng)合。

發(fā)明內(nèi)容
本發(fā)明的目的是提供一種地址跳轉(zhuǎn)輸出裝置，針對(duì)不同的電路部分設(shè)置對(duì)應(yīng)的二進(jìn)制地址排列組合，達(dá)到不同部分不同跳轉(zhuǎn)地址的效果，而降低設(shè)計(jì)時(shí)候的開(kāi)銷(xiāo)，減少跳轉(zhuǎn)電路資源消耗和出錯(cuò)概率。本發(fā)明提供一種地址跳轉(zhuǎn)輸出裝置，所述裝置包含循環(huán)計(jì)數(shù)器模塊，多路選擇器模塊，控制模塊和地址輸出模塊；所述循環(huán)計(jì)數(shù)器模塊將計(jì)數(shù)值輸出到所述多路選擇器模塊，所述控制模塊向多路選擇器模塊輸出控制命令來(lái)控制所述計(jì)數(shù)值的操作，最后將所述多路選擇器模塊操作結(jié)果輸出到所述地址輸出模塊。更進(jìn)一步，所述循環(huán)計(jì)數(shù)器模塊包含N個(gè)寄存器，且NS I。更進(jìn)一步，所述循環(huán)計(jì)數(shù)器模塊不停的進(jìn)行自增計(jì)數(shù)操作，每次自增量為1，且所述計(jì)數(shù)器模塊在O <計(jì)數(shù)值<所述寄存器表示上限之間循環(huán)計(jì)數(shù)。更進(jìn)一步，所述多路選擇器模塊包含至少一個(gè)多路選擇器。更進(jìn)一步，所述多路選擇器模塊根據(jù)所述控制模塊命令進(jìn)行所述計(jì)數(shù)值的重新排列。本發(fā)明還提供一種地址跳轉(zhuǎn)輸出控制方法，所述方法包括步驟一，配置多路選擇器組；步驟二，循環(huán)計(jì)數(shù)器開(kāi)始計(jì)數(shù)并輸出計(jì)數(shù)結(jié)果到多路選擇器組；步驟三，多路選擇器組根據(jù)配置信息對(duì)計(jì)數(shù)結(jié)果進(jìn)行重新排序；步驟四，多路選擇器組將結(jié)果輸出。采用本發(fā)明的技術(shù)方案后，能有效降低設(shè)計(jì)時(shí)候的開(kāi)銷(xiāo)，減少跳轉(zhuǎn)電路資源消耗和出錯(cuò)概率。


圖I是本發(fā)明實(shí)施例的結(jié)構(gòu)示意 圖2是本發(fā)明實(shí)施例的步驟流程示意 圖3是本發(fā)明實(shí)施例的電路 框圖。
具體實(shí)施例方式為了使本發(fā)明的目的、技術(shù)方案及優(yōu)點(diǎn)更加清楚明白，以下結(jié)合附圖及實(shí)施例，對(duì)本發(fā)明進(jìn)行進(jìn)一步詳細(xì)說(shuō)明。應(yīng)當(dāng)理解，此處所描述的具體實(shí)施例僅僅用以解釋本發(fā)明，并不用于限定本發(fā)明。附圖I是本發(fā)明實(shí)施例的結(jié)構(gòu)示意圖。在本實(shí)施例中，裝置共分為4個(gè)部分 第一個(gè)部分，101，是一個(gè)循環(huán)計(jì)數(shù)器模塊，該計(jì)數(shù)器模塊可以根據(jù)需要包含至少一個(gè)
的寄存器，計(jì)數(shù)器在系統(tǒng)時(shí)鐘驅(qū)動(dòng)下會(huì)不停的執(zhí)行“+I”計(jì)數(shù)操作。其計(jì)數(shù)值從O —直加到寄存器所能表示的數(shù)值上限，然后回到O重新開(kāi)始累加。第二個(gè)部分，102，是一個(gè)多路選擇器模塊，該模塊是一個(gè)多路選擇器組，該多路選擇器組包含了至少一個(gè)多路選擇器，多路選擇器組中的每個(gè)選擇器會(huì)根據(jù)控制模塊104的控制信息做不同的選擇，通過(guò)每個(gè)多路選擇器的選擇來(lái)完成值的重新排列，然后將結(jié)果送給地址輸出103。第三個(gè)部分，103，是一個(gè)地址輸出模塊，該模塊儲(chǔ)存下多路選擇器組輸出的值并送給需要此地址的電路。第四個(gè)部分，104，是一個(gè)控制模塊模塊，該模塊根據(jù)需要向多路選擇器組送出不同的控制信息來(lái)控制多路選擇器組中每個(gè)多路選擇器的選擇，最終實(shí)現(xiàn)不同的地址跳轉(zhuǎn)功倉(cāng)泛。在本實(shí)施例中，該裝置擁有一個(gè)循環(huán)計(jì)數(shù)器，一個(gè)多路選擇器組以及控制該多路選擇器組內(nèi)多路選擇器的控制模塊。通過(guò)多路選擇器組內(nèi)的不同選擇，最終可以使得地址輸出模塊按照需要地址就行跳轉(zhuǎn)輸出。附圖2是本發(fā)明實(shí)施例的步驟流程示意圖。在本實(shí)施例中，包含以下步驟
步驟一，201，工作開(kāi)始。步驟二，202，根據(jù)需要的地址跳轉(zhuǎn)方案配置多路選擇器組，來(lái)實(shí)現(xiàn)預(yù)期的排列組合關(guān)系。步驟三，203，循環(huán)計(jì)數(shù)器開(kāi)始“加I”計(jì)數(shù)，輸出計(jì)數(shù)的二進(jìn)制結(jié)果，如“00000000”，“ 00000001 ”,“00000010 ”,“00000011”…·。循環(huán)計(jì)數(shù)器擁有一個(gè)可設(shè)定的計(jì)數(shù)上限，達(dá)到上
限后自動(dòng)從O開(kāi)始重新計(jì)數(shù)。步驟四，204，循環(huán)計(jì)數(shù)器的值以二進(jìn)制的形式送給多路選擇器組。如“00000000”，“00000001”，“00000010”，“00000011” ....等。步驟五，205，多路選擇器組中的每個(gè)多路選擇器會(huì)根據(jù)配置從計(jì)數(shù)器輸出的二進(jìn)制值中選擇相應(yīng)的位輸出，這些位就組成了最后的地址。在本實(shí)施例中，通過(guò)設(shè)定多路選擇器組的不同配置，使得計(jì)數(shù)器不停累加的輸出計(jì)數(shù)變成不同的地址跳變，實(shí)現(xiàn)所需要的地址跳變結(jié)果。圖3是本發(fā)明實(shí)施例的跳轉(zhuǎn)電路框圖，256個(gè)地址需要8比特的二進(jìn)制來(lái)表示，Cnt [OrCnt [7]，8個(gè)寄存器分別代表了計(jì)數(shù)器的8個(gè)比特位。MUX0-3是多路選擇器，其中，MUX1-3的輸 入和MUXO是一樣的，限于篇幅在圖上未連線。Addr
是地址寄存器的8個(gè)比特位，MUX0-3的選擇結(jié)果分別送給地址寄存器的對(duì)應(yīng)位置。具體工作原理如下
計(jì)數(shù)器的8個(gè)比特位Cnt[7rCnt
按照Clk時(shí)鐘周期不停的加1，也即，{Cnt[7]，Cnt[6]，Cnt[5]，Cnt[4]，Cnt[3]，Cnt[2]，Cnt[I]，Cnt[O]}按照{(diào)00000000}， {00000001}，{00000010}，{00000011}…·這樣變化。計(jì)數(shù)器從O —直加到255，然后又重新開(kāi)始從O —直加到255，重復(fù)4次，配合多路選擇器完成4個(gè)部分的地址跳轉(zhuǎn)。第一種跳轉(zhuǎn)方式要實(shí)現(xiàn)0，64，128，192，I, 65，129，193···的地址跳轉(zhuǎn)，只要做如下配置配置 MUX0，選擇{Addr[l]，Addr
}的輸入為{Cnt[3], Cnt[2]}。配置 MUX1，選擇{Addr[3],Addr[2]}的輸入為{Cnt[5], Cnt [4]}。配置MUX2，選擇{Addr [5], Addr [4]}的輸入為 ICnt [7]，(社[6]}。配置願(yuàn)父3，選擇{Addr [7], Addr [6]}的輸入為{Cnt[l], Cnt [O]}。跳轉(zhuǎn)對(duì)應(yīng)列表如表I所示
表I :
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第二種跳轉(zhuǎn)方式要實(shí)現(xiàn)0，16，32，48，I, 17，33，49…的地址跳轉(zhuǎn)，只要在計(jì)數(shù)器第二輪從O加到255的過(guò)程中做如下配置配置MUX0，選擇{Addr[I],Addr[O]}的輸入為{Cnt[3]，Cnt [2]}。配置 MUXl，選擇{Addr [3], Addr [2]}的輸入為{Cnt[5], Cnt [4]}。配置MUX2，選擇{Addr [5], Addr [4]}的輸入為{Cnt[l], Cnt [O]}。配置 MUX3，選擇{Addr [7], Addr [6]}的輸入為 ICnt [7]，Cnt [6]}。跳轉(zhuǎn)對(duì)應(yīng)列表如表2所示
表2 :
!€ Γ]Χ! ItI Ir nt [ |,Ctii 14 j.Cri!i5],C!；；i；X n [] I ] I Add |' j, AdCi 161, Add; 5 ], ΛΛ ι μ|. Addi [·;, Addi | ], |
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第三種跳轉(zhuǎn)方式要實(shí)現(xiàn)0，4，8，12，I, 5，9，13…的地址跳轉(zhuǎn)，只要在計(jì)數(shù)器第三輪從O加到255的過(guò)程中做如下配置配置MUX0，選擇{Addr [I], Addr [O]}的輸入為{Cnt[3],Cnt [2]}。配置 MUXl，選擇{Addr [3], Addr [2]}的輸入為{Cnt[l], Cnt [O]}。配置 MUX2，選擇{Addr [5], Addr [4]}的輸入為{Cnt[5], Cnt [4]}。配置 MUX3，選擇{Addr [7], Addr [6]}的輸入為 ICnt [7]，Cnt [6]}。跳轉(zhuǎn)對(duì)應(yīng)列表如表3所示
表3 :
權(quán)利要求
1.一種地址跳轉(zhuǎn)輸出裝置，其特征在于，所述裝置包含循環(huán)計(jì)數(shù)器模塊，多路選擇器模塊，控制模塊和地址輸出模塊；所述循環(huán)計(jì)數(shù)器模塊將計(jì)數(shù)值輸出到所述多路選擇器模塊，所述控制模塊向多路選擇器模塊輸出控制命令來(lái)控制所述計(jì)數(shù)值的操作，最后將所述多路選擇器模塊操作結(jié)果輸出到所述地址輸出模塊。
2.根據(jù)權(quán)利要求I所述的地址跳轉(zhuǎn)輸出裝置，其特征在于，所述循環(huán)計(jì)數(shù)器模塊包含N個(gè)寄存器，且N≥I。
3.根據(jù)權(quán)利要求I和2所述的地址跳轉(zhuǎn)輸出裝置，其特征在于，所述循環(huán)計(jì)數(shù)器模塊不停的進(jìn)行自增計(jì)數(shù)操作，每次自增量為1，且所述計(jì)數(shù)器模塊在O <計(jì)數(shù)值<所述寄存器表示上限之間循環(huán)計(jì)數(shù)。
4.根據(jù)權(quán)利要求I至3所述的地址跳轉(zhuǎn)輸出裝置，其特征在于，所述多路選擇器模塊包含至少一個(gè)多路選擇器。
5.根據(jù)權(quán)利要求I至3所述的地址跳轉(zhuǎn)輸出裝置，其特征在于，所述多路選擇器模塊根據(jù)所述控制模塊命令進(jìn)行所述計(jì)數(shù)值的重新排列。
6.一種地址跳轉(zhuǎn)輸出控制方法，其特征在于，所述方法包括步驟一，配置多路選擇器組；步驟二，循環(huán)計(jì)數(shù)器開(kāi)始計(jì)數(shù)并輸出計(jì)數(shù)結(jié)果到多路選擇器組；步驟三，多路選擇器組根據(jù)配置信息對(duì)計(jì)數(shù)結(jié)果進(jìn)行重新排序；步驟四，多路選擇器組將結(jié)果輸出。
全文摘要
一種地址跳轉(zhuǎn)輸出裝置，所述裝置包含循環(huán)計(jì)數(shù)器模塊，多路選擇器模塊，控制模塊和地址輸出模塊；所述循環(huán)計(jì)數(shù)器模塊將計(jì)數(shù)值輸出到所述多路選擇器模塊，所述控制模塊向多路選擇器模塊輸出控制命令來(lái)控制所述計(jì)數(shù)值的操作，最后將所述多路選擇器模塊操作結(jié)果輸出到所述地址輸出模塊。采用本發(fā)明的技術(shù)方案后，能有效降低設(shè)計(jì)時(shí)候的開(kāi)銷(xiāo)，減少跳轉(zhuǎn)電路資源消耗和出錯(cuò)概率。
文檔編號(hào)G11C8/04GK102708916SQ201210109780
公開(kāi)日2012年10月3日 申請(qǐng)日期2012年4月16日 優(yōu)先權(quán)日2012年4月16日
發(fā)明者何毅華 申請(qǐng)人:東莞市泰斗微電子科技有限公司