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一種基于FPGA的MVB事件仲裁優(yōu)化與設(shè)計(jì)方法與流程

文檔序號(hào):11285959閱讀:來(lái)源:國(guó)知局

技術(shù)特征:

技術(shù)總結(jié)
本發(fā)明涉及一種MVB事件仲裁優(yōu)化方法,特別是一種基于FPGA的MVB事件仲裁優(yōu)化與設(shè)計(jì)方法。該方法根據(jù)信道容量自適應(yīng)調(diào)整優(yōu)先級(jí)數(shù),保障實(shí)時(shí)性要求高的信息優(yōu)先發(fā)送,提高M(jìn)VB網(wǎng)絡(luò)事件仲裁的服務(wù)性能。所設(shè)計(jì)的仲裁器包括解碼模塊、編碼模塊、仲裁模塊、時(shí)鐘模塊和緩存模塊,各個(gè)模塊在仲裁有限狀態(tài)機(jī)的邏輯控制下能實(shí)時(shí)對(duì)MVB網(wǎng)絡(luò)并發(fā)事件進(jìn)行有效仲裁。

技術(shù)研發(fā)人員:胡黃水;沈瑋娜;楊興旺;王瑩;鄭曼;柳虹亮
受保護(hù)的技術(shù)使用者:長(zhǎng)春工業(yè)大學(xué)
技術(shù)研發(fā)日:2017.05.12
技術(shù)公布日:2017.09.22
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