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一種總線載板、數(shù)據(jù)交互系統(tǒng)、數(shù)據(jù)處理方法及裝置與流程

文檔序號:11541753閱讀:來源:國知局
一種總線載板、數(shù)據(jù)交互系統(tǒng)、數(shù)據(jù)處理方法及裝置與流程

技術(shù)特征:
1.一種總線載板,其特征在于,反射內(nèi)存板設(shè)置于所述總線載板上,所述總線載板包括:底板;以及,設(shè)置于所述底板上的處理器,所述處理器用于讀取所述反射內(nèi)存板的第一數(shù)據(jù),將所述第一數(shù)據(jù)發(fā)送給實(shí)時仿真計算機(jī),并且,讀取所述實(shí)時仿真計算機(jī)的第二數(shù)據(jù),將所述第二數(shù)據(jù)寫入所述反射內(nèi)存板;所述底板上承載有:與所述實(shí)時仿真計算機(jī)的總線連接的總線接口、與所述總線接口連接的總線接口電路、與外部顯示器連接的外設(shè)調(diào)試接口和與電源連接的電源接口。2.根據(jù)權(quán)利要求1所述的總線載板,其特征在于,所述總線載板設(shè)置有第一寄存器和第二寄存器;所述第一寄存器,用于存儲所述處理器寫入的第一數(shù)據(jù),以使所述實(shí)時仿真計算機(jī)從所述第一寄存器讀取所述第一數(shù)據(jù),所述第一數(shù)據(jù)為所述處理器從所述反射內(nèi)存板讀取的數(shù)據(jù);所述第二寄存器,用于存儲所述實(shí)時仿真計算機(jī)寫入的第二數(shù)據(jù),以使所述處理器從所述第二寄存器讀取所述第二數(shù)據(jù),并將所述第二數(shù)據(jù)寫入所述反射內(nèi)存板。3.根據(jù)權(quán)利要求2所述的總線載板,其特征在于,所述第一寄存器和所述第二寄存器均為先入先出FIFO寄存器。4.一種數(shù)據(jù)交互系統(tǒng),其特征在于,包括:如權(quán)利要求1-3中任意一項(xiàng)所述的總線載板。5.一種數(shù)據(jù)處理方法,其特征在于,應(yīng)用于總線載板的處理器,所述總線載板包括所述處理器和底板,所述處理器設(shè)置于所述底板上,反射內(nèi)存板設(shè)置于所述總線載板上,所述方法包括:讀取所述反射內(nèi)存板的第一數(shù)據(jù),將所述第一數(shù)據(jù)發(fā)送往實(shí)時仿真計算機(jī);讀取所述實(shí)時仿真計算機(jī)的第二數(shù)據(jù),將所述第二數(shù)據(jù)寫入所述反射內(nèi)存板;其中,所述底板上承載有:與所述實(shí)時仿真計算機(jī)的總線連接的總線接口、與所述總線接口連接的總線接口電路、與外部顯示器連接的外設(shè)調(diào)試接口和與電源連接的電源接口。6.根據(jù)權(quán)利要求5所述的方法,其特征在于,所述總線載板設(shè)置有第一寄存器和第二寄存器;讀取所述反射內(nèi)存板的第一數(shù)據(jù),將所述第一數(shù)據(jù)發(fā)送往所述實(shí)時仿真計算機(jī)的過程包括:從所述反射內(nèi)存板讀取第一數(shù)據(jù),將所述第一數(shù)據(jù)寫入所述第一寄存器,以使所述實(shí)時仿真計算機(jī)從所述第一寄存器讀取所述第一數(shù)據(jù);讀取所述實(shí)時仿真計算機(jī)的第二數(shù)據(jù),將所述第二數(shù)據(jù)寫入所述反射內(nèi)存板的過程包括:從所述第二寄存器讀取第二數(shù)據(jù),所述第二數(shù)據(jù)為所述實(shí)時仿真計算機(jī)寫入所述第二寄存器中的數(shù)據(jù);將從所述第二寄存器讀取的第二數(shù)據(jù)寫入所述反射內(nèi)存板。7.一種數(shù)據(jù)處理裝置,其特征在于,應(yīng)用于總線載板的處理器,所述總線載板包括所述處理器和底板,所述處理器設(shè)置于所述底板上,反射內(nèi)存板設(shè)置于所述總線載板上,所述裝置包括:第一數(shù)據(jù)讀取單元,用于讀取所述反射內(nèi)存板的第一數(shù)據(jù);第一數(shù)據(jù)發(fā)送單元,用于將所述第一數(shù)據(jù)發(fā)送往實(shí)時仿真計算機(jī);第二數(shù)據(jù)讀取單元,用于讀取所述實(shí)時仿真計算機(jī)的第二數(shù)據(jù);第二數(shù)據(jù)寫入單元,用于將所述第二數(shù)據(jù)寫入所述反射內(nèi)存板;所述底板上承載有:與所述實(shí)時仿真計算機(jī)的總線連接的總線接口、與所述總線接口連接的總線接口電路、與外部顯示器連接的外設(shè)調(diào)試接口和與電源連接的電源接口。8.根據(jù)權(quán)利要求7所述的裝置,其特征在于,所述處理器內(nèi)部設(shè)置有第一寄存器和第二寄存器;所述第一數(shù)據(jù)發(fā)送單元包括:第一數(shù)據(jù)寫入子單元,用于將所述第一數(shù)據(jù)寫入所述第一寄存器,以使所述實(shí)時仿真計算機(jī)從所述第一寄存器讀取第一數(shù)據(jù);所述第二數(shù)據(jù)寫入單元包括:第二數(shù)據(jù)讀取子單元,用于從所述第二寄存器讀取第二數(shù)據(jù),所述第二數(shù)據(jù)為所述實(shí)時仿真計算機(jī)寫入所述第二寄存器中的數(shù)據(jù);第二數(shù)據(jù)寫入子單元,用于將所述第二數(shù)據(jù)寫入所述反射內(nèi)存板。
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