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智能卡芯片仿真器的制作方法

文檔序號(hào):6335624閱讀:238來(lái)源:國(guó)知局
專(zhuān)利名稱:智能卡芯片仿真器的制作方法
技術(shù)領(lǐng)域
本發(fā)明涉及智能卡領(lǐng)域,特別是涉及一種使用低端FPGA芯片實(shí)現(xiàn)仿真芯片的智能卡芯片仿真器。
背景技術(shù)
智能卡內(nèi)有用戶開(kāi)發(fā)的用戶程序,在用戶程序的編寫(xiě)和調(diào)試中,所使用的工具一般是智能卡芯片仿真器。仿真器內(nèi)使用包含產(chǎn)品芯片各項(xiàng)功能的仿真芯片,用于模擬產(chǎn)品卡的工作行為??紤]到仿真器的使用數(shù)量較少,相應(yīng)的某種型號(hào)芯片的仿真芯片使用量也很少,而流片費(fèi)用(幾十到一百萬(wàn))和風(fēng)險(xiǎn)都很高。為了降低成本,很多廠商都已經(jīng)不設(shè)計(jì)、 流片單獨(dú)的針對(duì)某種型號(hào)產(chǎn)品芯片的仿真芯片,轉(zhuǎn)而使用FPGA(現(xiàn)場(chǎng)可編程門(mén)陣列)芯片以及針對(duì)具體芯片型號(hào)設(shè)計(jì)的網(wǎng)表來(lái)替代流片的仿真芯片。FPGA芯片加網(wǎng)表實(shí)現(xiàn)的仿真芯片(簡(jiǎn)稱FPGA形式仿真芯片),由于FPGA芯片可反復(fù)使用,通過(guò)修改、更新FPGA芯片內(nèi)的網(wǎng)表可以實(shí)現(xiàn)不同的設(shè)計(jì),模擬不同型號(hào)的芯片功能,相比于制作專(zhuān)用仿真芯片,費(fèi)用節(jié)省很多,仿真芯片的通用性也更強(qiáng)、設(shè)計(jì)風(fēng)險(xiǎn)也大大降低,所以FPGA形式仿真芯片在仿真器類(lèi)產(chǎn)品中占據(jù)的比率越來(lái)越高。智能卡芯片的特點(diǎn)是內(nèi)部時(shí)鐘結(jié)構(gòu)復(fù)雜,需要有供給不同算法、不同接口模塊的多路時(shí)鐘,而最終的智能卡產(chǎn)品芯片引出的引腳很少,在產(chǎn)品芯片中芯片內(nèi)部各路不同算法、接口模塊需要的時(shí)鐘都需要芯片在內(nèi)部自行產(chǎn)生。現(xiàn)有的仿真器中,在使用FPGA芯片實(shí)現(xiàn)仿真芯片時(shí),同樣在FPGA芯片內(nèi)產(chǎn)生多路時(shí)鐘,由于這需要占用大量的FPGA芯片時(shí)鐘資源,就不得不選擇帶有很多時(shí)鐘資源的高端FPGA芯片,這些高端的FPGA芯片價(jià)格高昂 (幾千到幾萬(wàn)元一片)、采購(gòu)周期長(zhǎng),客觀上增加了仿真器的成本和生產(chǎn)時(shí)間。而低端FPGA 芯片(幾百到一千元一片)由于其所包含的時(shí)鐘資源較少,無(wú)法實(shí)現(xiàn)仿真芯片內(nèi)所需的多路時(shí)鐘,無(wú)法用于實(shí)現(xiàn)智能卡芯片的仿真芯片。

發(fā)明內(nèi)容
本發(fā)明要解決的技術(shù)問(wèn)題是提供一種智能卡芯片仿真器,可以使用時(shí)鐘資源較少的FPGA芯片來(lái)實(shí)現(xiàn)仿真芯片,并保證仿真器內(nèi)仿真芯片執(zhí)行用戶程序的功能與產(chǎn)品芯片一致。為解決上述技術(shù)問(wèn)題,本發(fā)明的智能卡芯片仿真器,包括時(shí)鐘源模塊,具有多個(gè)時(shí)鐘輸出引腳,用于產(chǎn)生多路時(shí)鐘信號(hào);仿真芯片,采用FPGA芯片實(shí)現(xiàn),該FPGA芯片的I/O接口與所述時(shí)鐘源模塊的時(shí)鐘輸出引腳相連接;對(duì)所述時(shí)鐘信號(hào)進(jìn)行處理后傳送給其它模塊使用。采用本發(fā)明的智能卡芯片仿真器,可以使用時(shí)鐘資源較少的低端FPGA芯片來(lái)實(shí)現(xiàn)仿真芯片,并保證仿真器內(nèi)仿真芯片執(zhí)行用戶程序的功能與產(chǎn)品芯片一致;有助于進(jìn)一步降低智能卡芯片仿真器的制作成本、縮短生產(chǎn)周期。


下面結(jié)合附圖和具體實(shí)施方式
對(duì)本發(fā)明作進(jìn)一步詳細(xì)的說(shuō)明附圖是本發(fā)明的智能卡芯片仿真器一實(shí)施例結(jié)構(gòu)示意具體實(shí)施例方式需要先了解的是,即使是時(shí)鐘資源較少的FPGA芯片,引出的I/O接口也有幾十到幾百個(gè),這些I/O接口可以作為外部時(shí)鐘信號(hào)的輸入。仿真器是給用戶調(diào)試用戶程序使用的,因此對(duì)仿真器的設(shè)計(jì)要求是用戶程序在仿真器內(nèi)仿真芯片上執(zhí)行時(shí)表現(xiàn)出來(lái)的功能與在產(chǎn)品芯片上執(zhí)行時(shí)表現(xiàn)出來(lái)的功能盡可能一致,用戶并不關(guān)心仿真器的實(shí)現(xiàn)原理和架構(gòu)寸。如圖所示,在一實(shí)施例中,所述智能卡芯片仿真器,包括仿真芯片2和時(shí)鐘源模塊3。所述仿真芯片2使用時(shí)鐘資源較少的低端FPGA芯片實(shí)現(xiàn),所述的時(shí)鐘源模塊3能產(chǎn)生多路時(shí)鐘信號(hào)。時(shí)鐘源模塊3有多個(gè)時(shí)鐘輸出引腳,時(shí)鐘輸出引腳L···時(shí)鐘輸出引腳 η,與實(shí)現(xiàn)仿真芯片2的FPGA芯片的I/O接口(I0L··· IOn)連接,向仿真芯片2輸出多路時(shí)鐘信號(hào)。所述的時(shí)鐘源模塊3可以用多個(gè)有源晶振實(shí)現(xiàn),也可以用多個(gè)可設(shè)置輸出時(shí)鐘信號(hào)頻率的專(zhuān)用時(shí)鐘發(fā)生芯片實(shí)現(xiàn),無(wú)論是有源晶振還是專(zhuān)用時(shí)鐘發(fā)生芯片,價(jià)格都很低廉 (幾元到十幾元)。這樣,使用FPGA芯片實(shí)現(xiàn)的仿真芯片2內(nèi)無(wú)需再使用有限的內(nèi)部時(shí)鐘資源產(chǎn)生滿足各個(gè)算法、接口模塊需要的時(shí)鐘信號(hào),只需要把時(shí)鐘源模塊3送過(guò)來(lái)的那些時(shí)鐘信號(hào)做一些簡(jiǎn)單處理(例如分頻等)分別送給各個(gè)算法、接口模塊即可。即使某一型號(hào)的智能卡產(chǎn)品芯片內(nèi)需要產(chǎn)生很多路的時(shí)鐘信號(hào),采用本發(fā)明的智能卡芯片仿真器中的仿真芯片2也可以使用時(shí)鐘資源較少的低端FPGA來(lái)實(shí)現(xiàn)了。同時(shí),所述仿真器1內(nèi)仿真芯片2相比于產(chǎn)品芯片在功能上沒(méi)有任何減少,還是與產(chǎn)品芯片一致的, 執(zhí)行用戶程序時(shí)所表現(xiàn)出的功能也必然是一致的,可以滿足用戶調(diào)試程序的需求。以上通過(guò)具體實(shí)施方式
對(duì)本發(fā)明進(jìn)行了詳細(xì)的說(shuō)明,但這些并非構(gòu)成對(duì)本發(fā)明的限制。在不脫離本發(fā)明原理的情況下,本領(lǐng)域的技術(shù)人員還可做出許多變形和改進(jìn),這些也應(yīng)視為本發(fā)明的保護(hù)范圍。
權(quán)利要求
1.一種智能卡芯片仿真器,其特征在于,包括時(shí)鐘源模塊,具有多個(gè)時(shí)鐘輸出引腳,用于產(chǎn)生多路時(shí)鐘信號(hào); 仿真芯片,采用FPGA芯片實(shí)現(xiàn),該FPGA芯片的I/O接口與所述時(shí)鐘源模塊的時(shí)鐘輸出引腳相連接;對(duì)所述時(shí)鐘信號(hào)進(jìn)行處理后傳送給其它模塊使用。
2.如權(quán)利要求1所述的智能卡芯片仿真器,其特征在于所述時(shí)鐘源模塊采用多個(gè)有源晶振實(shí)現(xiàn),也可以用多個(gè)可設(shè)置輸出時(shí)鐘信號(hào)頻率的專(zhuān)用時(shí)鐘發(fā)生芯片實(shí)現(xiàn)。
全文摘要
本發(fā)明公開(kāi)了一種智能卡芯片仿真器,包括時(shí)鐘源模塊,具有多個(gè)時(shí)鐘輸出引腳,用于產(chǎn)生多路時(shí)鐘信號(hào);仿真芯片,采用FPGA芯片實(shí)現(xiàn),該FPGA芯片的I/O接口與所述時(shí)鐘源模塊的時(shí)鐘輸出引腳相連接;對(duì)所述時(shí)鐘信號(hào)進(jìn)行處理后傳送給其它模塊使用。本發(fā)明可以使用時(shí)鐘資源較少的FPGA芯片來(lái)實(shí)現(xiàn)仿真芯片,并保證仿真器內(nèi)仿真芯片執(zhí)行用戶程序的功能與產(chǎn)品芯片一致;有助于進(jìn)一步降低智能卡芯片仿真器的制作成本、縮短生產(chǎn)周期。
文檔編號(hào)G06F11/26GK102467429SQ20101053928
公開(kāi)日2012年5月23日 申請(qǐng)日期2010年11月11日 優(yōu)先權(quán)日2010年11月11日
發(fā)明者許國(guó)泰 申請(qǐng)人:上海華虹集成電路有限責(zé)任公司
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