技術(shù)編號(hào)：6596841
提示：您尚未登錄，請(qǐng)點(diǎn) 登 陸 后下載，如果您還沒有賬戶請(qǐng)點(diǎn) 注 冊(cè) ，登陸完成后，請(qǐng)刷新本頁查看技術(shù)詳細(xì)信息。本發(fā)明涉及存儲(chǔ)器技術(shù)，特別涉及一種實(shí)現(xiàn)預(yù)讀式FIFO的方法和預(yù)讀式FIFO。 背景技術(shù)在現(xiàn)場(chǎng)可編程門陣列(FPGA)設(shè)計(jì)中，先入先出寄存器(FIFO)是最常用的功能模 塊之一，按照對(duì)接口時(shí)序要求的不同，F(xiàn)IFO可以分為預(yù)讀式FIFO和非預(yù)讀式FIFO兩種，其 中，預(yù)讀式FIFO能夠提高后級(jí)模塊的處理效率，因此在高速設(shè)計(jì)中經(jīng)常使用。預(yù)讀式FIFO與非預(yù)讀式FIFO的區(qū)別主要在于預(yù)讀式FIFO中，在有數(shù)據(jù)的情 況下，數(shù)據(jù)已經(jīng)準(zhǔn)備在總線上，即用戶在發(fā)起讀請(qǐng)求之前...
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該專利適合技術(shù)人員進(jìn)行技術(shù)研發(fā)參考以及查看自身技術(shù)是否侵權(quán)，增加技術(shù)思路，做技術(shù)知識(shí)儲(chǔ)備，不適合論文引用。
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