技術(shù)編號：6485329
提示：您尚未登錄，請點 登 陸 后下載，如果您還沒有賬戶請點 注 冊 ，登陸完成后，請刷新本頁查看技術(shù)詳細(xì)信息。提供了彼此之間沒有數(shù)據(jù)依賴性的多個加法指令。第一加法指令將它的進(jìn)位輸出存儲在標(biāo)志寄存器的第一標(biāo)志內(nèi)，并且不修改標(biāo)志寄存器內(nèi)的第二標(biāo)志。第二加法指令將它的進(jìn)位輸出存儲在標(biāo)志寄存器的第二標(biāo)志內(nèi)，并且不修改標(biāo)志寄存器內(nèi)的第一標(biāo)志。專利說明具有獨立進(jìn)位鏈的加法指令[0001]本發(fā)明的實施例一般涉及計算機處理器架構(gòu)，更具體而言，涉及當(dāng)被執(zhí)行時導(dǎo)致特定結(jié)果的指令。[0002]相關(guān)技術(shù)的描述[0003]加法指令通常被包括在指令集架構(gòu)(ISA)內(nèi)。大量加法指令通常出現(xiàn)在乘...
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