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用于多處理器核執(zhí)行的編組機(jī)制的制作方法技術(shù)資料下載

技術(shù)編號(hào):6351187

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用于多處理器核執(zhí)行的編組機(jī)制背景技術(shù)具有在多個(gè)處理器上執(zhí)行的并發(fā)線(xiàn)程的計(jì)算機(jī)應(yīng)用展現(xiàn)出增加性能的巨大前景,但是也向開(kāi)發(fā)者提出巨大挑戰(zhàn)。隨著處理器制造商在提供處理器時(shí)鐘頻率的顯著提高方面遇到障礙,原始順序處理能力的增長(zhǎng)已經(jīng)平淡化。處理器繼續(xù)演進(jìn),但是針對(duì)改善處理器能力的當(dāng)前焦點(diǎn)是在單個(gè)晶片上提供多個(gè)處理器核以增加處理器吞吐量。隨著處理器核數(shù)目增加,以前受益于增加的時(shí)鐘速度的順序應(yīng)用獲得顯著更少的縮放比例。為了利用多核系統(tǒng),編寫(xiě)了并發(fā)(或并行)應(yīng)用以包括分布在...
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