技術(shù)編號(hào)：6340923
提示：您尚未登錄，請(qǐng)點(diǎn) 登 陸 后下載，如果您還沒有賬戶請(qǐng)點(diǎn) 注 冊(cè) ，登陸完成后，請(qǐng)刷新本頁(yè)查看技術(shù)詳細(xì)信息。本發(fā)明涉及一種屬于計(jì)算機(jī)系統(tǒng)結(jié)構(gòu)中的多線程并行編程模型，特別涉及一種基 于眾核處理器和分區(qū)結(jié)構(gòu)的硬件型事務(wù)存儲(chǔ)方法。背景技術(shù)隨著處理器的迅速發(fā)展，多核處理器成為當(dāng)今處理器發(fā)展的主流，即便是對(duì)性能 要求較低的桌面型應(yīng)用也已經(jīng)進(jìn)入了多核時(shí)代。業(yè)界已經(jīng)推出了幾款眾核處理器，計(jì)算核 的數(shù)目進(jìn)一步增加。在處理器已經(jīng)提供了充裕的硬件并行能力的情況下硬件系統(tǒng)對(duì)上層軟 件提出了更高的要求，即軟件能夠有效利用處理器所提供的并行處理能力。目前，多線程編 程中關(guān)鍵的共享資源同步...
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該專利適合技術(shù)人員進(jìn)行技術(shù)研發(fā)參考以及查看自身技術(shù)是否侵權(quán)，增加技術(shù)思路，做技術(shù)知識(shí)儲(chǔ)備，不適合論文引用。
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