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高性能中頻數(shù)字化儀的制作方法

文檔序號:6524095閱讀:120來源:國知局
高性能中頻數(shù)字化儀的制作方法
【專利摘要】本發(fā)明公開了一種高性能中頻數(shù)字化儀,包括FPGA,F(xiàn)PGA和ADC數(shù)據(jù)采集模塊、時鐘分配模塊均相連,所述ADC數(shù)據(jù)采集模塊和時鐘分配模塊相連,F(xiàn)PGA和DSP、SPI口、RS232串口均相連,DSP和100M以太網(wǎng)、RS232串口相連。FPGA和DSP的連接點之間還連接有外部存儲器接口。所述外部存儲器接口和NORFlash或者同步動態(tài)隨機存儲器或者NANDFlash相連。本發(fā)明設(shè)置ADC數(shù)據(jù)采集模塊對數(shù)據(jù)進行采樣,再傳送到FPGA實現(xiàn)對數(shù)據(jù)的進一步識別和分選,傳輸給SPI接口處和DSP處進行窄帶和寬帶的并發(fā)任務(wù)處理,通過DSP對數(shù)據(jù)進行壓縮,提高數(shù)據(jù)的存儲深度,并利用DSP的強大的處理數(shù)據(jù)能力對數(shù)據(jù)進行回放,同時和以太網(wǎng)交互,實現(xiàn)寬帶的任務(wù)處理,減少了數(shù)據(jù)上傳時間、提高了信號處理能力、方便快捷。
【專利說明】高性能中頻數(shù)字化儀
【技術(shù)領(lǐng)域】
[0001]本發(fā)明涉及一種數(shù)字化儀,具體涉及一種網(wǎng)絡(luò)和SPI混合的中頻數(shù)字化儀。
【背景技術(shù)】
[0002]數(shù)字化儀是將圖像和圖形的連續(xù)模擬量轉(zhuǎn)換為離散的數(shù)字量的裝置,是在專業(yè)應(yīng)用領(lǐng)域中一種用途非常廣泛的圖形輸入設(shè)備,是由電磁感應(yīng)板、游標(biāo)和相應(yīng)的電子電路組成。當(dāng)使用者在電磁感應(yīng)板上移動游標(biāo)到指定位置,并將十字叉的交點對準(zhǔn)數(shù)字化的點位時,按動按鈕,數(shù)字化儀則將此時對應(yīng)的命令符號和該點的位置坐標(biāo)值排列成有序的一組信息,然后通過接口(多用串行接口)傳送到主計算機。
[0003]現(xiàn)在的數(shù)字化儀不能支持多通道寬帶和窄帶并發(fā)任務(wù),配合使用的固件實現(xiàn)的功能少,且信號處理能力模擬性能不強、數(shù)據(jù)上傳時間過長、并不能方便快速的得到應(yīng)用。

【發(fā)明內(nèi)容】

[0004]為解決上述問題,本發(fā)明提供一種能夠提高信號處理能力提高模擬性能的高性能中頻數(shù)字化儀。
[0005]本發(fā)明的目的通過以下技術(shù)方案來達到:
包括FPGA,所述FPGA連接有ADC數(shù)據(jù)采集模塊和時鐘分配模塊,所述ADC數(shù)據(jù)采集模塊和時鐘分配模塊相連,F(xiàn)PGA還連接有DSP、SPI 口和RS232串口,所述DSP連接有100M以太網(wǎng)和RS232串口。FPGA和DSP的連接點之間還連接有外部存儲器接口。所述外部存儲器接口和NOR Flash或者同步動態(tài)隨機存儲器或者NAND Flash相連。
[0006]所述ADC數(shù)據(jù)采集模塊和可控放大器相連。
[0007]所述ADC數(shù)據(jù)采集模塊為2個,ADC數(shù)據(jù)采集模塊為2ch 14bit,每個ADC數(shù)據(jù)采集模塊和2個可控放大器的相連。ADC數(shù)據(jù)采集模塊為雙通道,14bit,80Msa的高性能芯片。
[0008]DSP還連接有音頻接口。
[0009]所述ADC數(shù)據(jù)采集模塊和可控放大器相連,ADC數(shù)據(jù)采集模塊和2個可控放大器的相連。
[0010]DSP 為 TMS320C6713。FPGA 為 EP3C80 或者 EP3C120。
[0011]本發(fā)明與現(xiàn)有技術(shù)相比,所具有以下的優(yōu)點和有益效果:
本發(fā)明設(shè)置ADC數(shù)據(jù)采集模塊對數(shù)據(jù)進行采樣,再傳送到FPGA實現(xiàn)對數(shù)據(jù)的進一步識別和分選,傳輸給SPI接口處和DSP處進行窄帶和寬帶的并發(fā)任務(wù)處理,通過DSP對數(shù)據(jù)進行壓縮,提高數(shù)據(jù)的存儲深度,并利用DSP的強大的處理數(shù)據(jù)能力對數(shù)據(jù)進行回放,同時和以太網(wǎng)交互,實現(xiàn)寬帶的任務(wù)處理,減少了數(shù)據(jù)上傳時間、提高了信號處理能力、方便快捷。
【專利附圖】

【附圖說明】
[0012]圖1為本發(fā)明的結(jié)構(gòu)示意圖。【具體實施方式】
[0013]下面結(jié)合實施例對本發(fā)明作進一步的詳細(xì)說明,但本發(fā)明的實施方式不限于此。
[0014]實施例1
如圖1所示,包括FPGA,所述FPGA連接有ADC數(shù)據(jù)采集模塊和時鐘分配模塊,所述ADC數(shù)據(jù)采集模塊和時鐘分配模塊相連,F(xiàn)PGA還連接有DSP、SPI 口和RS232串口,所述DSP連接有100M以太網(wǎng)和RS232串口。ADC數(shù)據(jù)采集模塊對數(shù)據(jù)進行采樣,再傳送到FPGA實現(xiàn)對數(shù)據(jù)的進一步識別和分選,傳輸給SPI接口處和DSP處進行窄帶和寬帶的并發(fā)任務(wù)處理,通過DSP對數(shù)據(jù)進行壓縮,提高數(shù)據(jù)的存儲深度,并利用DSP的強大的處理數(shù)據(jù)能力對數(shù)據(jù)進行回放,同時和以太網(wǎng)交互,實現(xiàn)寬帶的任務(wù)處理,減少了數(shù)據(jù)上傳時間、提高了信號處理能力、方便快捷。本實施例中,F(xiàn)PGA采用ALTERA FPGA,EP3C80或者EP3C120。DSP采用TIDSP,為 TMS320C6713。
[0015]FPGA和DSP的連接點之間還連接有外部存儲器接口。所述外部存儲器接口和NORFlash和/或者同步動態(tài)隨機存儲器和/或者NAND Flash相連。外部存儲器接口即EMIF的性能優(yōu)良和外部的同步動態(tài)隨機存儲器(SDRAM)、異步器件連接時具有很大的方便性和靈活性,根據(jù)DSP的不同,EMIF總線為32位或者16位。
[0016]所述ADC數(shù)據(jù)采集模塊和可控放大器相連。
[0017]所述ADC數(shù)據(jù)采集模塊為2個,ADC數(shù)據(jù)采集模塊為2ch 14bit,每個ADC數(shù)據(jù)采集模塊和2個可控放大器的相連。ADC數(shù)據(jù)采集模塊為雙通道,14bit,80Msa的高性能芯片。
[0018]DSP還連接有音頻接口??梢赃B接音頻設(shè)備,輸出聲音信號。
[0019]所述ADC數(shù)據(jù)采集模塊和可控放大器相連,ADC數(shù)據(jù)采集模塊和2個可控放大器的相連??煽胤糯笃髦С?13dB?-18dB的增益調(diào)整。
[0020]本發(fā)明包括ADC數(shù)據(jù)采集模塊、數(shù)字信號處理器件和SPIU00M網(wǎng)絡(luò)接口,實現(xiàn)中頻信號采樣和處理,進一步的,可根據(jù)應(yīng)用需要選配固件以實現(xiàn)檢測、捕獲等目的。
【權(quán)利要求】
1.高性能中頻數(shù)字化儀,其特征在于:包括FPGA,所述FPGA連接有ADC數(shù)據(jù)采集模塊和時鐘分配模塊,所述ADC數(shù)據(jù)采集模塊和時鐘分配模塊相連,F(xiàn)PGA還連接有DSP、SPI 口和RS232串口,所述DSP連接有IOOM以太網(wǎng)和RS232串口。
2.根據(jù)權(quán)利要求1所述的高性能中頻數(shù)字化儀,其特征在于:FPGA和DSP的連接點之間還連接有外部存儲器接口。
3.根據(jù)權(quán)利要求3所述的高性能中頻數(shù)字化儀,其特征在于:所述外部存儲器接口和NOR Flash或者同步動態(tài)隨機存儲器或者NAND Flash相連。
4.根據(jù)權(quán)利要求1所述的高性能中頻數(shù)字化儀,其特征在于:ADC數(shù)據(jù)采集模塊和可控放大器相連。
5.根據(jù)權(quán)利要求1所述的高性能中頻數(shù)字化儀,其特征在于:所述ADC數(shù)據(jù)采集模塊為2個,ADC數(shù)據(jù)采集模塊為2ch 14bit。
6.根據(jù)權(quán)利要求1所述的高性能中頻數(shù)字化儀,其特征在于:時鐘分配模塊還和外部主系統(tǒng)時鐘輸入相連。
7.根據(jù)權(quán)利要求1-6任一項所述的高性能中頻數(shù)字化儀,其特征在于:DSP還連接有音頻接口。
8.根據(jù)權(quán)利要求1-6任一項所述的高性能中頻數(shù)字化儀,其特征在于:所述ADC數(shù)據(jù)采集模塊和可控放大器相連,ADC數(shù)據(jù)采集模塊和2個可控放大器的相連。
【文檔編號】G06F13/40GK103870426SQ201310691838
【公開日】2014年6月18日 申請日期:2013年12月17日 優(yōu)先權(quán)日:2013年12月17日
【發(fā)明者】萬傳彬, 陸建國, 王林, 陳剛, 李華, 王云, 樊宏坤 申請人:成都國蓉科技有限公司
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